IEEE 802.3af PD Interface and PWM Controllers
with Integrated Power MOSFETs
______________________________________________________________________________________ 23
Figure 9. DC-DC Converter Block Diagram (Voltage-Mode PWM Controller and Two-Switch Power Stage)
OVT
DCUVLO
REFOK
REGOK
OVRLD
T
T
5V
5V
80礎
33礎
IFLT
5V
OVRLD
CPWM
ILIM
DCUVLO
REGOUT
RCFF
FLTINT
RAMP
OPTO
CSS
GND
INBIAS
HVIN
DCUVLO
PPWM
BST
XFRMRH
DRVIN
XFRMRL
DRNH
SRC
PGND
RTCT
CS
REGOK
REG
OVT
REFOK
REF
(1.25V)
7.5V
50&
GND
Q
D
R
Q
R
T-FF
SHDN
OSC
50&
GND
R
S
Q
CLK
THERMAL
SHUTDOWN
OVT
1.25V
DCUVLO
80ns
DELAY
LEADING-
EDGE
DELAY
ONE
SHOT
LEVEL
SHIFT
10MHz
PGND
150mV
QH
QB
QL
0.4&
30&
0.4&
MAX5953A
MAX5953B
MAX5953C
MAX5953D
2.7V/1.9V
Block Diagrams (continued)
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